Optimisation de la puissance dans les circuits de routage des FPGA - Muthusamy, Sundar Prakash Balaji
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Ce travail optimise la puissance dans les SRAM 4T, 5T, 6T, 7T, 8T, 9T et 10T en comparant leurs configurations. Deux modes de fonctionnement sont proposés : le mode I et le mode II. Un circuit de pilotage d'écriture SRAM 10T est proposé et la comparaison de la puissance statique, de la dissipation de puissance statique, des mesures de performance comme le produit de retard de puissance et le produit de retard d'énergie sont comparés en utilisant TANNER 7.0. Dans le futur, un circuit de travail logique adiabatique doit être mis en oeuvre et des résultats doivent être obtenus.

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Produktbeschreibung
Ce travail optimise la puissance dans les SRAM 4T, 5T, 6T, 7T, 8T, 9T et 10T en comparant leurs configurations. Deux modes de fonctionnement sont proposés : le mode I et le mode II. Un circuit de pilotage d'écriture SRAM 10T est proposé et la comparaison de la puissance statique, de la dissipation de puissance statique, des mesures de performance comme le produit de retard de puissance et le produit de retard d'énergie sont comparés en utilisant TANNER 7.0. Dans le futur, un circuit de travail logique adiabatique doit être mis en oeuvre et des résultats doivent être obtenus.
Autorenporträt
Dr. Sundar Prakash Balaji erwarb seinen Doktortitel an der Anna University, Chennai. Er besitzt einen Bachelor- und einen Master-Abschluss der Anna-Universität, Chennai. Derzeit arbeitet er als außerordentlicher Professor am RVS Technical Campus - Coimbatore. Seine Interessen liegen in den Bereichen Low Power VLSI Design, ASIC Design und Solid State Devices.