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Mit den raschen Verbesserungen in der IC-Technologie und den Entwicklungen in der Signalverarbeitung sind überabgetastete SigmaDelta-ADCs aufgrund ihrer effizienten Architekturen und der einfachen Implementierung in VLSI-Technologie zur absoluten Wahl unter den kompetenten Datenwandlern geworden. Ihre Effizienz liegt in den Techniken zur Verkleinerung der Fläche, zur Verringerung des Stromverbrauchs und zur Verbesserung des Frequenzgangs, ohne dabei die Entwicklungskosten und den Kompatibilitätsfaktor zu belasten. Sie haben ihre eigenen Probleme, die verbessert oder optimiert werden müssen, um mit effizienten Designs mithalten zu können. In diesem Buch wird der Entwurf eines leistungs- und geschwindigkeitseffizienten Dezimierungsfilters mit optimierter Fläche für breitbandige Sigma-Delta-Analog-Digital-Wandler vorgestellt. Es wird ein Arbeitsablauf für einen schnellen Entwurf dieses optimierten Dezimierungsfilters in MATLAB sowie die Generierung von HDL-Code für die Implementierung vorgestellt. Techniken wie transponierte Polyphasendekomposition in direkter Form, Pipelining, Retiming, gemeinsame Nutzung von Ressourcen und CSD-Codierung werden als mögliche Lösungen für einen effizienten Entwurf diskutiert.