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Band 871 - 13%

Wide-Bandwidth High Dynamic Range D/A Converters

Aus der Reihe The Springer International Series in Engineering and Computer Science
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138,99 € UVP 160,49 €

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Beschreibung

Produktdetails

Einband

Taschenbuch

Erscheinungsdatum

29.11.2010

Verlag

Springer Us

Seitenzahl

202

Maße (L/B/H)

24/16/1,3 cm

Gewicht

366 g

Auflage

Softcover reprint of hardcover 1st ed. 2006

Sprache

Englisch

ISBN

978-1-4419-4026-1

Beschreibung

Produktdetails

Einband

Taschenbuch

Erscheinungsdatum

29.11.2010

Verlag

Springer Us

Seitenzahl

202

Maße (L/B/H)

24/16/1,3 cm

Gewicht

366 g

Auflage

Softcover reprint of hardcover 1st ed. 2006

Sprache

Englisch

ISBN

978-1-4419-4026-1

Herstelleradresse

Springer-Verlag KG
Sachsenplatz 4-6
1201 Wien
AT

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  • Glossary Abbreviations Preface
    1: Digital to Analog conversion concepts
    1.1 Functional aspects
    1.2 Algorithmic aspects
    1.3 Signal processing aspects
    1.4 Circuit aspects
    1.5 Conclusions
    2: Framework for Analysis and Synthesis of DACs
    2.1 Overview
    2.2 Framework description

    3: Current Steering DACs
    3.1 Basic circuit
    3.2 Implementations and technology impact

    4: Dynamic limitations of Current Steering DACs
    4.1 State of the art in dynamic linearity
    4.2 Dynamic limitations of current steering DACs
    4.3 Conclusions

    5: Current Steering DAC circuit error analysis
    5.1 Amplitude domain errors
    5.2 Time domain errors
    5.3 Conclusions

    6: High-level modeling of Current Steering DACs
    6.1 System modeling
    6.2 Error properties and classification
    6.3 Functional error generation mechanisms
    6.4 Conclusions
    7: Functional modeling of timing errors
    7.1 Non-uniform timing
    7.2 Stochastic non-uniform timing analysis
    7.3 Deterministic non-uniform timing
    7.4 Conclusions
    8: Functional analysis of local timing errors
    8.1 Local timing error analysis
    8.2 High level architectural parameter tradeoffs: segmentation
    8.3 Conclusions

    9: Circuit analysis of local timing errors
    9.1 Circuit analysis with linear models
    9.2 Local timing error tradeoffs
    9.3 Conclusions 10: Synthesis concepts for CS DACs
    10.1 Information management in the CS DAC
    10.2 Synthesis Policy
    10.3 A-posteriori error correction methods
    10.4 Conclusions
    11: Design of a 12 bit 500 Msample/s DAC
    11.1 Design approach
    11.2 Architecture
    11.3 Switched-Current cell
    11.4 Decoder, data synchronization and conditioning
    11.5 Layout
    11.6 Experimental results
    11.7 Conclusions
    References
    A: Output spectrum for timing errors
    A.1 Power spectrum of y(t) for random timing errors
    A.2 Spectrum of y(t) for deterministic timing errors

    B: Literature data