Conception et implémentation d'une unité MAC 64 bits basée sur un FPGA
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De nos jours, dans le domaine VLSI, la taille, la puissance et la vitesse de la technologie sont les principales contraintes pour la conception de tout circuit. Dans les multiplicateurs normaux, le retard est plus important et le nombre de calculs est également plus élevé. C'est pourquoi la vitesse des circuits conçus avec les multiplicateurs normaux sera faible et ils consommeront plus d'énergie. Ce livre décrit l'unité de multiplication et d'accumulation à l'aide d'un multiplicateur védique et de portes logiques réversibles DKG. Le multiplicateur védique est conçu à l'aide du Ur...
De nos jours, dans le domaine VLSI, la taille, la puissance et la vitesse de la technologie sont les principales contraintes pour la conception de tout circuit. Dans les multiplicateurs normaux, le retard est plus important et le nombre de calculs est également plus élevé. C'est pourquoi la vitesse des circuits conçus avec les multiplicateurs normaux sera faible et ils consommeront plus d'énergie. Ce livre décrit l'unité de multiplication et d'accumulation à l'aide d'un multiplicateur védique et de portes logiques réversibles DKG. Le multiplicateur védique est conçu à l'aide du Urdhava Triyagbhayam sutra et l'additionneur est conçu à l'aide de la logique réversible pour effectuer des opérations à grande vitesse. Les portes logiques réversibles constituent également une contrainte essentielle pour le domaine prometteur de l'informatique quantique. Le multiplicateur Urdhava Triyagbhayam est utilisé pour la fonction de multiplication afin de réduire les produits partiels dans le processus de multiplication et d'obtenir un concert élevé et une surface réduite. La logique réversible est utilisée pour réduire la puissance. Le MAC est conçu à l'aide du code Verilog, la simulation et la synthèse sont effectuées avec le compilateur RTL de Xilinx et mises en oeuvre sur la carte FPGA Spartan 3e.
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