IMPLEMENTACIÓN DE UNA ARQUITECTURA DE NÚCLEO RISC DE 32 BITS DE ALTO RENDIMIENTO
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- Spanisch ausgewählt
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UVP
43,90 €
inkl. gesetzl. MwSt.,
Beschreibung
Produktdetails
Einband
Taschenbuch
Erscheinungsdatum
18.07.2023
Verlag
Ediciones Nuestro ConocimientoSeitenzahl
80
Maße (L/B/H)
22/15/0,5 cm
Gewicht
137 g
Sprache
Spanisch
ISBN
978-620-6-24553-7
Este libro trata sobre el diseño de un procesador RISC utilizando arquitectura pipelining. El pipelining de 5 etapas se utiliza para mejorar la velocidad de la operación. Las 5 etapas son Fetch, Decode, Execute, Memory y Write Back. El proceso de diseño incluye varias técnicas de bajo consumo a nivel arquitectónico que demuestran que estos métodos son más eficientes que las técnicas de reducción de consumo de Back-end. Los procesadores embebidos de bajo consumo se utilizan en una gran variedad de aplicaciones, como coches, teléfonos, cámaras digitales, impresoras y otros dispositivos similares. La razón de su amplio uso es que son pequeños, por lo que no ocupan mucha superficie y su fabricación es rentable. El bajo consumo de energía ayuda a reducir la disipación de calor, alargar la vida de la batería y aumentar la fiabilidad del dispositivo.
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