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Produktbild: Advanced HDL Synthesis and SOC Prototyping
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Advanced HDL Synthesis and SOC Prototyping RTL Design Using Verilog

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Beschreibung

Produktdetails

Einband

Gebundene Ausgabe

Erscheinungsdatum

18.01.2019

Abbildungen

XXI, 307 p. 263 illus., 196 illus. in color.

Verlag

Springer Singapore

Seitenzahl

307

Maße (L/B/H)

24,1/16/2,4 cm

Gewicht

612 g

Auflage

1st edition 2019

Sprache

Englisch

ISBN

978-981-10-8775-2

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Erscheinungsdatum

18.01.2019

Abbildungen

XXI, 307 p. 263 illus., 196 illus. in color.

Verlag

Springer Singapore

Seitenzahl

307

Maße (L/B/H)

24,1/16/2,4 cm

Gewicht

612 g

Auflage

1st edition 2019

Sprache

Englisch

ISBN

978-981-10-8775-2

Herstelleradresse

Springer-Verlag KG
Sachsenplatz 4-6
1201 Wien
AT

Email: ProductSafety@springernature.com

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  • Produktbild: Advanced HDL Synthesis and SOC Prototyping
  • Introduction.- SOC Design.- RTL Design Guidelines.- RTL Design and Verification.- Processor cores and Architecture design.- Buses and protocols in SOC designs.- DSP Algorithms and Video Processing.- ASIC and FPGA Synthesis.- Static Timing Analysis.- SOC Prototyping.- SOC Prototyping guidelines.- Design Integration and SOC synthesis.- Interconnect delays and Timing.- SOC Prototyping and debug techniques.- Testing at the board level.