Técnicas de diseño energéticamente eficientes en FPGA
Objetivo de diseño de bajo consumo con escalado de capacitancia, sensibilidad térmica, HSTL, SSTL y estándar IO LVCMOS y escalado de frecuencia
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En este libro hemos diseñado un decodificador de 64 bits, un decodificador habilitado para el Internet de las cosas (IoT), un controlador de semáforos energéticamente eficiente, barreras automáticas basadas en sensores para pasos a nivel públicos, un sensor de carga móvil que utiliza el estándar LVCMOS IO, un reloj de pulsera biomédico, un lector Unicode de griego, latín y sindhi, un reloj digital y un filtro FIR utilizando Verilog. Además, utilizamos objetivos de diseño, escalado de capacitancia, escalado de frecuencia, enfoque de diseño con reconocimiento térmico, sincronizació...
En este libro hemos diseñado un decodificador de 64 bits, un decodificador habilitado para el Internet de las cosas (IoT), un controlador de semáforos energéticamente eficiente, barreras automáticas basadas en sensores para pasos a nivel públicos, un sensor de carga móvil que utiliza el estándar LVCMOS IO, un reloj de pulsera biomédico, un lector Unicode de griego, latín y sindhi, un reloj digital y un filtro FIR utilizando Verilog. Además, utilizamos objetivos de diseño, escalado de capacitancia, escalado de frecuencia, enfoque de diseño con reconocimiento térmico, sincronización de reloj, escalado de voltaje, estándares LVCMOS IO, estándares HSTL IO y estándares SSTL IO. Utilizamos la última tecnología Virtex-6, Kintex-7 y Artix-7 FPGA basada en 28 nm y 40 nm. Estamos utilizando XPower Analyzer para la estimación de potencia y Xilinx para la simulación del lenguaje de descripción de hardware. En resumen, hemos cubierto más de 10 circuitos diferentes y 10 técnicas de eficiencia energética diferentes que ayudarán a los investigadores y estudiantes a aprender estas técnicas y aplicarlas en sus propios diseños con el fin de crear diseños energéticamente eficientes con Verilog.
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