Síntese de Circuitos Assíncronos a partir das Especificações Simulink
Uma abordagem à concepção de sistemas assíncronos a partir de uma especificação algorítmica
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Este trabalho introduz uma abordagem para sintetizar automaticamente os diagramas Simulink em circuitos assíncronos. É baseado no ambiente de co-desenho CodeSimulink, uma ferramenta desenvolvida no Politecnico di Torino capaz de converter diagramas Simulink em implementações síncronas. Este ambiente foi alargado de duas formas diferentes para o integrar com os fluxos convencionais FPGA e ASIC. O sistema gerado com FPGAs como alvo baseia-se na implementação de dados agregados, que necessita de cuidados especiais tanto durante a síntese como na colocação, a fim de manter a correcção ...
Este trabalho introduz uma abordagem para sintetizar automaticamente os diagramas Simulink em circuitos assíncronos. É baseado no ambiente de co-desenho CodeSimulink, uma ferramenta desenvolvida no Politecnico di Torino capaz de converter diagramas Simulink em implementações síncronas. Este ambiente foi alargado de duas formas diferentes para o integrar com os fluxos convencionais FPGA e ASIC. O sistema gerado com FPGAs como alvo baseia-se na implementação de dados agregados, que necessita de cuidados especiais tanto durante a síntese como na colocação, a fim de manter a correcção do circuito. Os diagramas Simulink são compilados em VHDL padrão e sintetizados com ferramentas convencionais fornecidas pelos fabricantes de chips. O código obtido é limitado para evitar optimizações de síntese indesejadas e limitado para implementar a "região equipotencial" necessária para sintetizar desenhos correctos e auto-temporizados. A implementação do ASIC utiliza o Timeless Design Environment by Handshake Solutions, uma cadeia de ferramentas comerciais capaz de sintetizar as especificações Haste em lógica assíncrona. Os testes experimentais mostraram bons resultados gerando circuitos mais pequenos mesmo do que o código manuscrito.
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