Entwicklung eines 13Bit-Analog-Digital-Wandlers mit Fehlerkorrektur
MixedSignal Design eines 13Bit SAR AD-Wandlers mit abgleichfreier Fehlerkorrektur des Wandlerergebnisses
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Die vorliegende Arbeit beschäftigt sich mit dem Entwurf eines Analog-Digital-Wandlers (ADC) mit einer Auflösung von 13Bit und einer effektiven Genauigkeit von 12Bit. Der ADC verfügt über Möglichkeiten der Selbstkalibrierung um einen Abgleich während der Produktion vermeiden zu können. Die mit 5V Versorgungsspannung arbeitende Schaltung ist in der Lage, Eingangsspannungen bis 2,5V mit einer maximalen Umsetzgeschwindigkeit von 30kHz in digitale Ausgangsworte zu wandeln. Der gesamte Wandler wurde zunächst auf Modellebene entworfen (VHDL-AMS, VHDL). Nach Verifikation der implementierten Al...
Die vorliegende Arbeit beschäftigt sich mit dem Entwurf eines Analog-Digital-Wandlers (ADC) mit einer Auflösung von 13Bit und einer effektiven Genauigkeit von 12Bit. Der ADC verfügt über Möglichkeiten der Selbstkalibrierung um einen Abgleich während der Produktion vermeiden zu können. Die mit 5V Versorgungsspannung arbeitende Schaltung ist in der Lage, Eingangsspannungen bis 2,5V mit einer maximalen Umsetzgeschwindigkeit von 30kHz in digitale Ausgangsworte zu wandeln. Der gesamte Wandler wurde zunächst auf Modellebene entworfen (VHDL-AMS, VHDL). Nach Verifikation der implementierten Algorithmen konnte eine Umsetzung der Baublöcke in analoge bzw. digitale Schaltungen erfolgen. Die analogen Schaltungen liegen als Schaltpläne, die digitalen Blöcke als synthetisierbare Logikbeschreibungen vor. Die Funktion der Schaltung wurde mittels Simulation nachgewiesen. Noch vorhandene Schwachstellen wurden lokalisiert und Ansätze zu deren Beseitigung gegeben.
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