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El diseño y el análisis del rendimiento del sistema de compresión de imágenes sin pérdidas rápido y eficiente (FELICS) basado en VLSI, que incluye varios métodos. En primer lugar, se utiliza un algoritmo de compresión basado en bloques para analizar las imágenes dentro de cada píxel antes de procesar el espacio de almacenamiento y, por tanto, reducir el tamaño de la memoria. En segundo lugar, para la compresión de imágenes se utiliza un kit FPGA basado en el algoritmo de codificación Set Partitioning in Hierarchical Trees y en la transformada wavelet discreta. En tercer lugar, la comunicación por satélite ha ido creciendo para el desarrollo de técnicas rápidas y eficientes, para el almacenamiento y transmisión de imágenes de satélite. Por último, se propone un sistema de compresión de imágenes sin pérdidas para VLSI basado en un Código Binario Ajustado Simplificado rápido y eficiente y en el algoritmo del Código de Arroz de Golomb para presentar la compresión de imágenes sin pérdidas. El futuro alcance de este módulo es que la calidad de la imagen se puede mejorar aún más con un alto valor pico de relación señal/ruido utilizando algunas otras técnicas de compresión. Este método puede mejorarse aún más mediante la implementación del kit Field Programmable Gate Array.