Conception de décaleurs de niveau à faible puissance et à haute vitesse pour les systèmes multi-VDD
Srinivasulu Gundala
Broschiertes Buch

Conception de décaleurs de niveau à faible puissance et à haute vitesse pour les systèmes multi-VDD

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La consommation d'énergie et les performances de vitesse des circuits VLSI peuvent être optimisées par un certain nombre de méthodologies, les méthodologies qui impliquent la réduction de la tension d'alimentation sont considérées comme des techniques efficaces et efficientes, car la diminution de la tension d'alimentation entraîne une réduction des performances de vitesse et de la consommation d'énergie de la conception VLSI. La meilleure approche, appelée Clustered Voltage Scaling, consiste à sectoriser l'ensemble de la conception en différents blocs ou îlots de tension et tou...