ASIC-Implementierung des Pezaris-Multiplikators in DIT-FFT-Architekturen
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Multiplikatoren mit großen Bitlängen haben einen großen Einfluss auf die Leistung digitaler Schaltungen in vielen Anwendungen wie Kryptographie, digitale Signalverarbeitung und Bildverarbeitung. Die Leistung vieler Berechnungsprobleme wird häufig von der Geschwindigkeit bestimmt, mit der eine Multiplikationsoperation ausgeführt werden kann. Dieses Buch gibt einen kurzen Überblick über verschiedene Multiplikatoren wie Baugh-Woley-, Pezaris-, Array-, Booth-, Vedic-Multiplikatoren und Kompressor-basierte Multiplikatoren. Das Hauptziel besteht darin, verschiedene Arten von Multiplizierern i...
Multiplikatoren mit großen Bitlängen haben einen großen Einfluss auf die Leistung digitaler Schaltungen in vielen Anwendungen wie Kryptographie, digitale Signalverarbeitung und Bildverarbeitung. Die Leistung vieler Berechnungsprobleme wird häufig von der Geschwindigkeit bestimmt, mit der eine Multiplikationsoperation ausgeführt werden kann. Dieses Buch gibt einen kurzen Überblick über verschiedene Multiplikatoren wie Baugh-Woley-, Pezaris-, Array-, Booth-, Vedic-Multiplikatoren und Kompressor-basierte Multiplikatoren. Das Hauptziel besteht darin, verschiedene Arten von Multiplizierern in Bezug auf Leistungsaufnahme, Fläche und Verzögerung zu vergleichen. Diese vorzeichenbehafteten Multiplikationskonzepte werden in Verilog HDL implementiert und in Cadence RTL Compiler mit 180nm Technologie umgesetzt.
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